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SignalTapII嵌入式逻辑分析器开展了正弦波、三角波、-s10在哪下注

作者:s10在哪下注 时间:2021-02-14 00:18
本文摘要:作者:梁勇,计琴本文说明了基于FPGA技术的DDS波形发生器的原理和设计,利用SignalTapII嵌入式逻辑分析器开展了正弦波、三角波、方波、锯齿波的建模检测。实验结果表明,利用FPGA可以在短时间内构建规定的波形,提高设计效率,具有实用价值。 1 .章DDS频率合成器的频率分辨率低,输入频率点多,平均具备2N个频率点(设DDS振幅存储器的字长为n )。频率变换速度快,平均us级频率变换时振幅倒数的优点是输入输入振幅噪声低、参照频率源的振幅噪声提高的宽带矢量信号。

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作者:梁勇,计琴本文说明了基于FPGA技术的DDS波形发生器的原理和设计,利用SignalTapII嵌入式逻辑分析器开展了正弦波、三角波、方波、锯齿波的建模检测。实验结果表明,利用FPGA可以在短时间内构建规定的波形,提高设计效率,具有实用价值。

1 .章DDS频率合成器的频率分辨率低,输入频率点多,平均具备2N个频率点(设DDS振幅存储器的字长为n )。频率变换速度快,平均us级频率变换时振幅倒数的优点是输入输入振幅噪声低、参照频率源的振幅噪声提高的宽带矢量信号。

只有能够生成规定波形的数字化构筑,构筑容易,小型轻量。本文说明了DDS的基本原理,同时详细说明了DDS波形发生器的FPGA构建,利用SignalTapII嵌入式逻辑分析器展开了正弦波、三角波、方波、锯齿波的建模检测。

2.DDS波形发生器的FPGA构建FPGA的应用不仅使数字电路系统的设计非常方便,而且其时钟频率已经超过几百兆赫兹,加上其灵活性和高可靠性,非常适合作为构建波形发生器的数字电路部分FPGA设计中使用的DDS电路比使用专用DDS芯片更灵活,只要转换FPGA的ROM数据,DDS就能生成规定的波形,相当灵活。2.1FPGA设计过程FPGA的设计框图是图1右图,FPGA的主要功能是需要生成与外围电路的模块电路,拒绝接收外围逻辑控制信号。包括保持频率字的振幅累加器,生成与主时钟频率完全相同的RAM传输率字的步骤和内部存储块中包含存储多个波形数据的ROM,可以通过适当的控制线自由选择。

有两个多波形自由选择输入构成输入地下通道,其中一个地下通道可以不具备倒挡相互功能。用内部的PLL倍增外部低频水晶振动,输入与主时钟相同频率的时钟。

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驱动芯片外高速D/A.2.2时钟模块为了通过奈奎斯特采样定理得到输入频率为10MHz的信号,输出的信号时钟频率需要约20MHz以上。采样频率越高,输入波形的平缓度越好,波形的采样点数也越少,获取的波形质量也越少。本设计中的DDS模块是高速模块,因此需要高拒绝系统时钟,不仅需要高频率,还需要足够低的稳定性,如果FPGA的时钟末端需要特别的高频水晶振动,不仅时钟不稳定,。


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